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華虹宏力“提升芯片良率和可靠性的方法”專(zhuān)利公布

日期:2025-02-11 閱讀:227
核心提示:據(jù)天眼查顯示,上海華虹宏力半導(dǎo)體制造有限公司提升芯片良率和可靠性的方法專(zhuān)利公布,申請(qǐng)公布日為2024年12月31日,申請(qǐng)公布號(hào)為

 據(jù)天眼查顯示,上海華虹宏力半導(dǎo)體制造有限公司“提升芯片良率和可靠性的方法”專(zhuān)利公布,申請(qǐng)公布日為2024年12月31日,申請(qǐng)公布號(hào)為CN119229936A。

本發(fā)明提供一種提升芯片良率和可靠性的方法,提供至少一個(gè)lot的晶圓,晶圓包括多個(gè)芯片,各個(gè)芯片上包含有多個(gè)包括閃存的存儲(chǔ)單元;進(jìn)行晶圓接受測(cè)試,記錄每片晶圓的存儲(chǔ)單元為編程狀態(tài)時(shí)的閾值電壓;把lot的編號(hào)、晶圓的編號(hào)以及對(duì)應(yīng)的晶圓的存儲(chǔ)單元為編程狀態(tài)時(shí)的閾值電壓生成附加文件;進(jìn)行良率測(cè)試和編程電壓調(diào)整:將附加文件代入第一良率測(cè)試,在一良率測(cè)試中繼承晶圓的存儲(chǔ)單元為編程狀態(tài)時(shí)的閾值電壓作為參數(shù)進(jìn)入之后的編程電壓調(diào)整流程;進(jìn)行編程電壓調(diào)整流程;進(jìn)行第二良率測(cè)試,在第二良率測(cè)試中根據(jù)測(cè)試結(jié)果調(diào)整閾值電壓的調(diào)整公式。本發(fā)明能夠根據(jù)工藝差異微調(diào)編程條件,以獲得最適合的工作條件,提升良率和可靠性。

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